Makefile 依赖项中的强制顺序

Question

我需要一些帮助来编写 GNU makefile。我有一个 C 程序“main.c”，它取决于文件“constants.h”中定义的“CONSTANT”的值。

“main.c”

#include <stdio.h>
#include "constants.h"

void work(void)
{
    int array[CONSTANT];
    for (int i = 0; i < CONSTANT; i++) {
        printf("%d\n", i);
    }
}

int main(int argc, char const* argv[])
{
    printf("constant=%d\n", CONSTANT);
    work();
    return 0;
}

“常数.h”

#ifndef CONSTANTS_H
#define CONSTANTS_H

#define CONSTANT 4
#endif

我在这里要做的是用不同的“CONSTANT”值来编译程序。例如，“out1”用“CONSTANT=1”和“make all”编译，我应该能够产生所有的变体（“out1”、“out2”和“out4”）。

问题是“main.c”所需的“a.o”也取决于“CONSTANT”的值。所以“a.o”必须在“sed%”之后编译。但是，据我了解，“make”中没有办法强制依赖项中的命令（我想这是使用 makefile 的全部意义）。

解决这种情况的推荐方法是什么？

“生成文件”

CC= gcc
CFLAGS  = -std=c99 -Wall

CONSTANTS = 1 2 4
targets = $(addprefix out, $(CONSTANTS))
seds = $(addprefix sed, $(CONSTANTS))

.PHONY: $(seds)
$(seds): sed%:
  sed -i 's/define CONSTANT [0-9]*/define CONSTANT $*/g' constants.h

$(targets): out%: main.c sed% a.o
  $(CC) $(CFLAGS) $< a.o -o $@

a.o: a.c constant.h
  $(CC) $(CFLAGS) $< a.o -o $@

 .PHONY: all
 all : $(targets)

请注意，我知道我可以重写“main.c”，以便它从命令行获取一个参数。实际上，“main.c”以外的许多其他文件都依赖于“CONSTANT”，所以我想避免重写所有这些文件。我也知道我可以执行“gcc -DCONSTANT=n main.c”之类的操作，但也必须重新编译依赖于“CONSTANT”的每个文件。

相关问题

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• Force order of dependencies in a Makefile

Answer 1

我知道我可以做一些类似“gcc -DCONSTANT=n main.c”的事情， 但是每个依赖于“CONSTANT”的文件也必须重新编译。

如果你有你的 makefile 生成，这不一定是一个障碍 每个编译配方中正确的 -DCONSTANT=n 和不同的目标文件。

这是一个插图：

constants.h

#ifndef CONSTANTS_H
#define CONSTANTS_H

#ifndef CONSTANT
#define CONSTANT 4
#endif

#endif

foo.c

#include "constants.h"

int foo = CONSTANT;

ma​​in.c

#include <stdio.h>
#include "constants.h"

extern int foo;

int main()
{
    printf("%d\n",CONSTANT + foo);
    return 0;
}

生成文件

CC := gcc
CFLAGS := -std=c99 -Wall

CONSTANTS = 1 2 4
TARGETS = $(addprefix out, $(CONSTANTS))
SRCS := main.c foo.c

define compile =
$(basename $(1))$(2).o: $(1) constants.h
    $$(CC) -c -DCONSTANT=$(2) $$(CFLAGS) $$< -o $$@
endef

.PHONY: all clean

all : $(TARGETS)

$(foreach src,$(SRCS),\
    $(foreach const,$(CONSTANTS),$(eval $(call compile,$(src),$(const))))) 

out%: main%.o foo%.o 
    $(CC) $^ -o $@


clean:
    rm -f $(TARGETS) *.o

运行如下：

$ make
gcc -c -DCONSTANT=1 -std=c99 -Wall main.c -o main1.o
gcc -c -DCONSTANT=1 -std=c99 -Wall foo.c -o foo1.o
gcc main1.o foo1.o -o out1
gcc -c -DCONSTANT=2 -std=c99 -Wall main.c -o main2.o
gcc -c -DCONSTANT=2 -std=c99 -Wall foo.c -o foo2.o
gcc main2.o foo2.o -o out2
gcc -c -DCONSTANT=4 -std=c99 -Wall main.c -o main4.o
gcc -c -DCONSTANT=4 -std=c99 -Wall foo.c -o foo4.o
gcc main4.o foo4.o -o out4

生成的程序运行如下：

$ for i in 1 2 4; do ./out$i; done
2
4
8