Verilog在进行数值比较时,一旦有负数存在,就一定要注意定义为signed型变量。 补充:在进行减法运算时,也要注意定义为signed型变量。 相关文章: 2022-01-11 2021-05-30 2021-06-15 2022-12-23 2021-08-09 2021-12-18