在哪里可以找到 zynq 7000 Xilinx 的引脚编号文件答案

【问题标题】：where to find pin number document of zynq 7000 Xilinx在哪里可以找到 zynq 7000 Xilinx 的引脚编号文件
【发布时间】：2015-09-04 22:31:10
【问题描述】：

我是 FPGA 新手，当我尝试在 zynq-7000 clg484 上实现我的解码器时，出现错误，提示：

Bitgen:342 - 此设计包含具有位置 (LOC) 的引脚非用户分配的或非用户分配的 I/O 标准 (IOSTANDARD)。这可能会导致 I/O 争用或与板电源不兼容或连接影响性能、信号完整性或在极端情况下造成设备或其连接的组件损坏。至防止此错误，强烈建议指定所有引脚位置和 I/O 标准，以避免潜在的争用或冲突，并允许适当的比特流创建。将此错误降级为警告并允许比特流使用未指定的 I/O 位置或标准创建，您可以应用以下 bitgen 开关：-g UnconstrainedPins:Allow

并且我尝试添加-g UnconstrainedPins:Allow，仍然不行，说'clk' pin不是最优的，但是说真的，我不知道哪个pin号是通用时钟pin号！

我在哪里可以找到解释板针号的文件？找不到所以不知道板上的哪个按钮映射到哪个数字，所以在PlanAhead(I/o pin规划)中，我总是不知道该定位哪个数字。

【问题讨论】：

你用的是哪块板子？在 Google 上搜索 <boardname> manual 或 <boardname> schematic。不要使用没有正确引脚分配的设计。
我的板子是 XC7Z020-clg484，但我不知道我需要哪个文件...这个是吗？@Paebbels zedboard.org/sites/default/files/ZedBoard_HW_UG_v1_1.pdf

标签： embedded xilinx zynq

【解决方案1】：

您的电路板是 ZedBoard，而不是 XC7Z020-clg484，它是您电路板的 Zynq 内核（黑色散热器下方的芯片）。 ZedBoard 的原理图可以在网站上找到。首先检查您的电路板版本：查看 Zynq 内核和 FMC 连接器之间的条形码标签。就在下方，您应该会在绿色标签上看到白色的“REV C”或“REV D”。接下来，转到http://zedboard.org/，支持 -> 文档 -> ZedBoard -> 原理图并下载您修订的原理图。你需要的一切都在那里。如果您想知道 Zynq 的哪个引脚驱动 LD0（靠近 8 个开关的 8 个用户 LED 中的最右侧），请搜索 LD0。您将看到它由 Zynq 的 bank 33 的引脚 T22 驱动，并且该 bank 具有 3.3V 电压。为了自动将 I/O 映射到 Zynq 的引脚，您可以使用这样的 TCL 脚本：

array set ios {
    "gpi[0]"    { "F22" "LVCMOS25" }
    "gpi[1]"    { "G22" "LVCMOS25" }
    "gpi[2]"    { "H22" "LVCMOS25" }
    "gpi[3]"    { "F21" "LVCMOS25" }
    "gpi[4]"    { "H19" "LVCMOS25" }
    "gpi[5]"    { "H18" "LVCMOS25" }
    "gpi[6]"    { "H17" "LVCMOS25" }
    "gpi[7]"    { "M15" "LVCMOS25" }
    "gpo[0]"    { "T22" "LVCMOS33" }
    "gpo[1]"    { "T21" "LVCMOS33" }
    "gpo[2]"    { "U22" "LVCMOS33" }
    "gpo[3]"    { "U21" "LVCMOS33" }
    "gpo[4]"    { "V22" "LVCMOS33" }
    "gpo[5]"    { "W22" "LVCMOS33" }
    "gpo[6]"    { "U19" "LVCMOS33" }
    "gpo[7]"    { "U14" "LVCMOS33" }
    "srst"      { "P16" "LVCMOS25" }
}
foreach io [ array names ios ] {
    set pin [ lindex $ios($io) 0 ]
    set std [ lindex $ios($io) 1 ]
    set_property package_pin $pin [get_ports $io]
    set_property iostandard $std [get_ports [list $io]]
}

在本例中，我们有一个 8 位输入总线 (GPI)、一个 8 位输出总线 (GPO) 和一个单位输入 (SRST)。 GPI 映射到 ZedBoad 的 8 个开关，GPO 映射到 8 个 LED，SRST 映射到 5 个按钮板的中心按钮。如您所见，gpo[0] 映射到我上面提到的 LED T22，其iostandard 属性为LVCMOS33 (3.3 V)。适应您自己的 I/O 名称和功能。保存 TCL 脚本 (foo.tcl) 并在您合成设计之后和实现它之前运行它：菜单 Tools -> Run TCL script... 如果您使用 GUI，否则您已经知道了。玩得开心。

【讨论】：